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Taxinomie de Flynn - Wikipédia

Taxinomie de Flynn

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La taxonomie de Flynn est une classification des architectures d'ordinateur, proposé par Micheal J. Flynn en 1966[1],[2]. Les quatre classifications définit par Flynn sont classés selon le type d'organisation du flux de données et du flux d'instructions .

  • SISD (instruction simple, une seule mémoire) - un ordinateur séquentiel qui exploites aucun parallélisme autant au niveau des instructions que de la mémoire. Cette catégorie correspond à l'Architecture de von Neumann. Supporte le parallélisme apparent.
  • SIMD (instruction simple, plusieurs mémoires) - Single Instruction Multiple Data - un ordinateur qui utilise le parallélisme au niveau de la mémoire, par exemple le Processeur vectoriel
  • MISD (instruction multiples, une seule mémoire) - Une même donné est traitée par plusieurs processeurs en parallèle. Peu d'implémentation en pratique, peut-être utilisé dans le filtrage numérique et la vérification de redondance dans les systèmes critique.
  • MIMD (instruction multiples, plusieurs mémoires) Multiple Instructions on Multiple Data - Plusieurs processeurs traitent des données différentes car chaque processeur possèdent une mémoire distincte . L'architecture parallèle la plus utilisé. Nous rencontrons principalement deux variantes soit:
  1. à mémoire partagée - Les processeurs ont accès à la mémoire comme un espace d'adressage global. Tout changement dans une case mémoire est vu par les autres CPU. La communication inter-CPU est effectuée via la mémoire globale.
  2. à mémoire distribuée - Chaque CPU a sa propre mémoire et système d'exploitation. Nécessite un middleware pour la synchronisation et la communication

Un système MIMD hybride est l'architecture la plus utilisé par les Superordinateur . ces systèmes hybride possèdent l'avantage d'être très extensible , performante et à faible coût.

[modifier] Réferences

  1. Flynn, M., Some Computer Organizations and Their Effectiveness, IEEE Trans. Comput., Vol. C-21, pp. 948, 1972.
  2. Duncan, Ralph, A Survey of Parallel Computer Architectures, IEEE Computer. February 1990, pp. 5-16.


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